Entonces la RAM de la computadora es DRAM. Supongo que conoce la estructura DRAM y, de lo contrario, le recomendaría la página en cmu.edu Diapositiva número 56.
Ahora que conoce la estructura de DRAM, pasemos al siguiente paso. DRAM recibe solicitudes no solo de la CPU, sino también de la GPU. Además, en general, todos los coprocesadores generalmente se comunican a través de la memoria compartida, que es DRAM (en la mayoría de los casos). Pero por el momento solo considere un procesador, es decir, CPU que accede a la DRAM. Ahora, cuando la CPU procesa una instrucción Cargar / Almacenar, accede a la memoria que es L1> L2> caché L3 (y tal vez más). Si los datos no están presentes en el caché LLC, entonces esos datos deben recuperarse de la DRAM. Ahora, si observara la organización de la DRAM, sabría qué componentes están presentes en la DRAM, de modo que la dirección se divide en varias subunidades que corresponden a un rango, banco, fila y columna específicos. Por ej. cuando solicita datos en la dirección 0x12345678, luego dice 0x1 corresponde al Rango 1, 0x23 corresponde al Banco 3 en ese rango, 0x456 corresponde a una fila en DRAM, 0x78 corresponde a la columna en esa fila, donde los datos están presentes. Esta es una descripción general de la memoria. Entonces puede decir que la memoria (en general cualquier memoria) está hecha de decodificador y unidad de almacenamiento. El decodificador divide la dirección en la dirección de las unidades respectivas y según se selecciona la fila, se selecciona la columna y se envían los datos.
Ahora incluso podemos mirar un poco más a fondo cómo DRAM almacena valor. Entonces eso ayuda a responder la pregunta de por qué se llama RAM dinámica. En DRAM, a diferencia de SRAM, el bloque de almacenamiento es capacitancia, que tiende a descargarse durante un período de tiempo y, por lo tanto, debe actualizarse periódicamente.
Ahora, cuando se selecciona una fila, habilitamos el transistor M1, es decir, manejamos la línea de palabras (WL) alto, lo que significa que la puerta de M1 es alta, por lo que está conectada, es decir, actúa como un interruptor conectado. Entonces, cualquier carga que esté en el condensador de almacenamiento Cs se transporta a través de M1 a la línea de bits. Ahora este valor es muy pequeño, por lo que después de leer el valor se amplifica a través del amplificador de detección. Por ej. qué sucederá si ya aplicamos 2.5V en BL antes de habilitar M1. Entonces, si Cs hubiera estado almacenando 1 lógico, entonces habría aumentado 2.5V a 2.6V, y luego esta diferencia se habría amplificado al valor lógico 1. Así que ahora lee 1. Y otro decodificador funcionará como decodificador de columna y seleccionará los bits que realmente desea (es decir, los solicitados por LLC).
Ahora DRAM, al igual que otros temas, también abarca muchos dominios, por lo que si necesita información específica a nivel de arquitectura, hardware y software, por favor comente.
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