Creo que es importante aclarar que la función ECC en la memoria del servidor es solo bits adicionales y que no se está realizando ninguna corrección en los DIMM de memoria.
El controlador de memoria en la CPU, cuando quiere almacenar una palabra (generalmente 64 bits) de datos en la memoria, crea los bits ECC realizando un cálculo en la palabra de datos y los escribe al mismo tiempo que los datos. Más tarde, cuando vuelve a leer la palabra de datos, también lee los bits de ECC adicionales y recalcula cuáles deberían ser los datos de ECC. Si coincide con lo recibido, todo está bien. Si no, la codificación puede usar los bits no coincidentes para determinar en la mayoría de los casos cuáles eran los bits incorrectos y corregir los datos. Si hay demasiados bits incorrectos, puede indicar que hubo un problema, pero no puede corregir los datos.
Entonces, a ese respecto, todo el ECC para la RAM del servidor se realiza en la CPU.
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Hay bits de paridad adicionales en los pines de comando y dirección en la memoria moderna para que también se pueda detectar un error de datos en esas transferencias.
Interna a la CPU, generalmente no hay bits ECC asociados con buses entre lógica. La memoria caché en chip puede ser una excepción.
